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Architecture avancée des processeurs

Architecture avancée des processeurs

En pratique :

Volume horaire de cours : 12
Volume horaire global de TD : 4
Volume horaire global de TP : 4
Langue principale : français

Modalités d’organisation et de suivi

À la fin de ce module, l'étudiant doit être capable de

  • Connaître les étapes d’exécution des instructions dans un processeur classique ;
  • Comprendre le fonctionnement pipeline d’un contrôleur de processeur ;
  • Comprendre les aléas de fonctionnement posés par le pipelinage d’un cœur de processeur ;
  • Comprendre les mécanismes permettant d'optimiser le code assembleur en vue d’obtenir de meilleures performances ;
  • Connaître le fonctionnement d’une hiérarchie mémoire ;
  • Analyser le gain obtenu par une hiérarchie mémoire par rapport à une exécution d’application donnée.

Discipline

  • Introduction
  • Rappel sur le fonctionnement pipeline
  • Techniques avancées permettant d’augmenter les performances
  • Evolutions actuelles des architectures, vers le multi-coeurs

Bibliographie, lectures recommandées

  • J.L.Hennessy, D.A.Patterson, Computer Architecture, Fifth Edition: A Quantitative Approach (The Morgan Kaufmann Series in Computer Architecture and Design) 5th Edition
  • Structured computer organization, 4 eme édition, A.S.Tanenbaum, Prentice Hall
  • Computer organization and architecture, 4 eme édition, W.Stalling, Prentice Hall
  • Architecture de l’ordinateur, E.Lazard, Collection Synthex, Pearson Education